| 专利名称 | 一种针对集成电路异质型逻辑单元的重综合方法 | 申请号 | CN201210559839.X | 专利类型 | 发明专利 | 公开（公告）号 | CN103886118A | 公开（授权）日 | 2014.06.25 | 申请（专利权）人 | 中国科学院微电子研究所;北京飘石科技有限公司 | 发明（设计）人 | 张峰;王作建;吴洋;于芳;刘忠立 | 主分类号 | G06F17/50(2006.01)I | IPC主分类号 | G06F17/50(2006.01)I | 专利有效期 | 一种针对集成电路异质型逻辑单元的重综合方法 至一种针对集成电路异质型逻辑单元的重综合方法 | 法律状态 | 实质审查的生效 | 说明书摘要 | 本发明公开了一种针对集成电路异质型逻辑单元的重综合方法，包括：逆拓扑序排列工艺映射后网表中所有节点；计算每个节点的cut；计算每个cut的函数f(X)；对函数f(X)进行分解；用功能性等价的LUTs结构与函数f(X)进行布尔匹配。利用本发明，能充分利用异质型逻辑单元中所有逻辑资源，从而减少所使用的LUT数。本发明能够广泛应用于工艺映射后重综合，能够在不损害电路延时的情况下去减小电路面积，降低设计成本，具有广阔的市场前景和应用价值。 |
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