| 专利名称 | FPGA芯片布线方法 | 申请号 | CN201110379987.9 | 专利类型 | 发明专利 | 公开（公告）号 | CN103136386A | 公开（授权）日 | 2013.06.05 | 申请（专利权）人 | 中国科学院微电子研究所 | 发明（设计）人 | 陈亮;李艳;于芳 | 主分类号 | G06F17/50(2006.01)I | IPC主分类号 | G06F17/50(2006.01)I | 专利有效期 | FPGA芯片布线方法 至FPGA芯片布线方法 | 法律状态 | 授权 | 说明书摘要 | 本发明公开了一种FPGA芯片布线方法。该方法包括：步骤A，读取上一次的FPGA芯片布线结果；步骤B，由上一次的布线结果获取关键路径延时和各源端i到漏端j之间的延时裕量；步骤C，由关键路径延时和各源端i到漏端j间的延时裕量获取每条线网的源端i到其所有漏端j的连接关键度；步骤D，由每条线网的源端i到其所有漏端j的连接关键度获取每条线网的关键度；步骤E，根据线网关键度由大至小的顺序对FPGA芯片中的线网进行排序；步骤F，根据排好的线网顺序，依次对FPGA芯片中的线网进行布线，获取布线结果。本发明FPGA芯片布线方法可以减少关键路径延时。 |
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