| 专利名称 | 一种基于Bypass技术的低功耗乘法器 | 申请号 | CN201310027083.9 | 专利类型 | 发明专利 | 公开（公告）号 | CN103092560A | 公开（授权）日 | 2013.05.08 | 申请（专利权）人 | 中国科学院自动化研究所 | 发明（设计）人 | 王东琳;侯化成;王惠娟;肖偌舟;林玻;张志伟 | 主分类号 | G06F7/523(2006.01)I | IPC主分类号 | G06F7/523(2006.01)I;G06F1/32(2006.01)I | 专利有效期 | 一种基于Bypass技术的低功耗乘法器 至一种基于Bypass技术的低功耗乘法器 | 法律状态 | 实质审查的生效 | 说明书摘要 | 本发明公开了一种低功耗高速乘法器装置，实现两个N位操作数相乘运算，主要采用基于门控行列Bypass技术的全加器和半加器，该乘法器包括Booth编码逻辑，Booth译码逻辑，基于Bypass的部分积压缩树和快速加法器等部件。Booth编码与译码逻辑，采用改进型Booth编码方式，对2个N位操作数进行处理，得到M个部分积。部分积压缩树对M个部分积进行处理，其压缩树的基本单元为基于行列Bypass的全加器和半加器，该Bypass技术使用门控单元来选择性关闭部分求和逻辑，减少晶体管的活动开关性，降低关键路径上的延时，从而做到高性能低功耗设计。 |
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