| 专利名称 | 低功耗流水线结构的相位累加器 | 申请号 | CN201210109997.5 | 专利类型 | 发明专利 | 公开（公告）号 | CN102638261A | 公开（授权）日 | 2012.08.15 | 申请（专利权）人 | 中国科学院微电子研究所 | 发明（设计）人 | 陈建武;吴旦昱;周磊;刘新宇;武锦;金智 | 主分类号 | H03L7/099(2006.01)I | IPC主分类号 | H03L7/099(2006.01)I;H03L7/18(2006.01)I | 专利有效期 | 低功耗流水线结构的相位累加器 至低功耗流水线结构的相位累加器 | 法律状态 | 实质审查的生效 | 说明书摘要 | 本发明公开了一种低功耗流水线结构相位累加器，摒弃传统结构中通过级联D触发器增加延时的方法，通过改变频率控制字单元中D触发器的时钟信号来调节延时，从而减少频率控制字单元中D触发器数量，降低功耗。对于M级流水线结构的N比特相位累加器，传统结构需要N×(M+1)/2个D触发器，本发明提供方法只需要N+M+1个D触发器。本发明的低功耗流水线结构相位累加器具有设计简单、功耗低、频率变化快的特点。 |
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